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文檔簡介
1、現(xiàn)代雷達(dá)系統(tǒng)主要采用數(shù)字波形合成方法來產(chǎn)生波形,這是因?yàn)閿?shù)字信號可以滿足現(xiàn)代雷達(dá)信號的頻率捷變、自適應(yīng)調(diào)頻以及波形參數(shù)捷變的要求。而在數(shù)字波形產(chǎn)生技術(shù)中,DDS(Direct Digital Synthesis,直接數(shù)字頻率合成)憑借其眾多的優(yōu)點(diǎn),已經(jīng)被廣泛的應(yīng)用在軍事和民用領(lǐng)域,基于DDS產(chǎn)生的各種波形,可以實(shí)現(xiàn)任意波形的雷達(dá)信號產(chǎn)生。
本文首先闡述了MIMO(Multiple-input Multiple-output
2、)雷達(dá)正交波形設(shè)計(jì)的基本理論,主要介紹序列二次規(guī)劃法。基于DDS原理,該算法得到的正交多相碼可以被用于產(chǎn)生正交波形。在對DDS原理進(jìn)行理論分析之后,根據(jù)波形產(chǎn)生系統(tǒng)指標(biāo)參數(shù)的要求,將DSP(Digital Signal Processing)和FPGA(Field ProgrammableGate Array)技術(shù)相結(jié)合,最終實(shí)現(xiàn)一個(gè)低成本、高擴(kuò)展性、使用方便的任意波形發(fā)生器,主要包括正弦波、方波、三角波、梯形波、脈動波等常規(guī)波形,并可
3、實(shí)現(xiàn)調(diào)頻調(diào)相。
首先,在硬件電路設(shè)計(jì)部分,使用Cadence開發(fā)工具,完成了整體的電路設(shè)計(jì)并且進(jìn)行了模擬電路部分的仿真工作。然后,在邏輯設(shè)計(jì)部分,根據(jù)原理和提出的一些改善算法,在Xilinx ISE的環(huán)境下,基于Spartan6系列的FPGA芯片實(shí)現(xiàn)邏輯設(shè)計(jì)。
最終的測試表明,該任意波形發(fā)生器頻率分辨率可達(dá)到30mHz,最高輸出頻率20MHz,頻率準(zhǔn)確度約為±0.1%。輸出端接50Ω負(fù)載時(shí),信號保持完好,性能
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