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1、該文通過對可編程邏輯器件PLD和現(xiàn)場可編程門陳列FPGA內(nèi)部結(jié)構(gòu)的研究, 結(jié)合軟件工程學(xué)中的結(jié)構(gòu)化設(shè)計(jì)思想和VHDL語言的特點(diǎn),給出了樹狀和方框圖兩種模塊結(jié)構(gòu),并將它們用于數(shù)字信號處理的設(shè)計(jì)中.該文重點(diǎn)研究了基于FPGA的數(shù)字濾波器設(shè)計(jì)與實(shí)現(xiàn)的新方法.該方法以全并行分布式算法為核心, 針對FPGA的特點(diǎn)采用了查找表(LUT)和快速進(jìn)位加法等技術(shù).通過用Xilinx仿真工具與MATLAB仿真工具對FIR濾波器的仿真結(jié)果相比較, 顯示了在F
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