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文檔簡介
1、本論文主要介紹HDMI_Tx芯片整體架構(gòu)設(shè)計以及其中音頻、視頻、包處理、HDCP模塊的設(shè)計方法。針對芯片設(shè)計中的難點,提供了分析方法,并對所做設(shè)計進行功仿與FPGA驗證,證明了設(shè)計的可行性。在設(shè)計過程中,依據(jù)HDMI以及HDCP的兼容性測試要求,進行可靠的強健性設(shè)計,同時考慮了信道傳輸過程中可能出現(xiàn)的誤碼率以及芯片工作在異常情況下的自恢復(fù)能力。在視頻接口模塊中,針對對下游HDCP模塊的影響,需恢復(fù)同步信號,并對視頻流采用謹慎更新與謹慎建
2、立的策略。 在芯片的驗證過程中,利用隨機源的設(shè)計,對RTL進行了全面的驗證,并針對現(xiàn)實測試的可行性,對CEA861B中規(guī)定的實際視頻幀進行了簡化,節(jié)約了大量的測試時間。 在電路設(shè)計中,不僅考慮了算法能否實現(xiàn),還要兼顧功耗與面積,從而壓低成本,這也是激烈的消費電子市場競爭的要求。 本項目的RTL設(shè)計部分依靠Mentor的QuastaSim6.3工具,使用VerilogIEEE2001語言,在驗證過程中使用Syste
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