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文檔簡介
1、數(shù)字視頻接口(DVI)與傳統(tǒng)的模擬視頻接口相比,在信號傳輸、圖像處理、速度上等方面具有壓倒性的優(yōu)勢,它可以為顯示設備和主機之間的互聯(lián)提供高達1.65GB/S的傳輸速率,降低了電路的功耗以及信號傳輸中的電磁干擾,已經成為顯示設備和主機相連的接口標準,其應用也越來越廣泛。 DVI-IP核包括發(fā)送器和接收器兩部分。本文根據(jù)DV11.0的規(guī)格要求,分別對發(fā)送器和接收器當中的編碼和解碼電路進行了研究與設計。論文研究了編解碼電路的作用、邏輯
2、流程,采用SMIC-工藝進行結構設計,完成了綜合和仿真。 編碼電路是發(fā)送器的一部分,它的功能主要是把8bit的視頻信號和2bit的控制信號編碼成為10bit的信號輸出給串行器。編碼過程中要注意的是參數(shù)cnt的作用,它主要被用來實現(xiàn)直流平衡,使得編碼輸出中的邏輯“1”和邏輯“0”的個數(shù)盡量保持平衡。 解碼電路是接收器的一部分,它的功能主要是把從發(fā)送器傳過來的10bit的編碼信號解碼出來,解碼出8bit的視頻信號、2bit的
3、控制信號以及1bit的使能信號DE。DE的邏輯狀態(tài)來選擇有效的解碼輸出。DE是高電平的時候,視頻解碼輸出是有效的輸出,當DE是低電平的時候,控制信號的解碼輸出是有效輸出。 DV11.0對時序也有嚴格的要求,它要求最短消隱持續(xù)時間長度為128個象素周期;而要求編碼/串行化最大延遲時間為64個象素周期,同樣要求解碼/并行化的最大延遲時間為64個象素周期。 仿真結果表明,所設計的電路可以完成DV11.0編解碼功能,具有較好的遠
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