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文檔簡介
1、邏輯綜合是FPGA支持軟件中關(guān)鍵的一個(gè)優(yōu)化步驟，其優(yōu)化結(jié)果直接影響了后續(xù)的布局布線等操作的性能。針對此問題，本文從工藝無關(guān)和工藝相關(guān)兩個(gè)方面對邏輯綜合方法進(jìn)行了研究與設(shè)計(jì)。在工藝無關(guān)的邏輯綜合中，提出了一種基于最大允許函數(shù)集的無關(guān)項(xiàng)優(yōu)化方法，并與網(wǎng)絡(luò)重構(gòu)和兩級(jí)邏輯優(yōu)化進(jìn)行實(shí)驗(yàn)對比。在工藝相關(guān)的邏輯綜合中，提出了一種基于可劃分集合，對查找表網(wǎng)絡(luò)進(jìn)行重連線的優(yōu)化算法。算法中提出了相似度的概念和構(gòu)造二部圖的方法，以及面向不同優(yōu)化目標(biāo)的啟發(fā)式方
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