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1、EDA技術(shù)技術(shù)第六章第六章對外圍硬件的訪問對外圍硬件的訪問第一節(jié)第一節(jié)LED一、電路結(jié)構(gòu)共陰極4位LED數(shù)碼管(點亮電平為高電平有效)循環(huán)點亮模式:依次點亮4個數(shù)碼管,每次選通一位數(shù)碼管,點亮持續(xù)一段時間后,選通下一位數(shù)碼管,依次點亮一次后循環(huán),實現(xiàn)循環(huán)點亮。8.8.8.8.112233445566778899101011111212U174LED4LED_14LED_24LED_34LED_44LED_54LED_64LED_74LE
2、D_84LED_94LED_104LED_114LED_124LEDR81331R82331R83331R84331R85331R86331R87331R88331R89331R90331R91331R92331二、VerilogHDL代碼Module:ledFilename:led.vAuth:WuBinDate:Jul.252006wireled_active_inwire[3:0]led__outwire[7:0]led_data
3、_outInternalDeclarationreg[2:0]statereg[2:0]cntcount4times(4LEDs)reg[17:0]DelayCnt顯示delay5msreg[3:0]顯示位選擇reg[7:0]data顯示數(shù)據(jù)ParameterDeclarationparameterIDLE=3h0STAT_DISP=3h1cnt計數(shù)次數(shù)判斷,判斷是否循環(huán)顯示了一次DISP=3h2數(shù)據(jù)輸出送顯DELAY=3h3顯示持續(xù)5
4、msDISP_END=3h4結(jié)束循環(huán)顯示一次MainBlockstatemachinealways@(posedgeclockposedgereset)beginif(reset)state=IDLEelsebegincase(state)IDLE:if(led_active_in)state=STAT_DISPSTAT_DISP:beginif(cnt==`LED)state=DISP_ENDelsestate=DISPend先在前一
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