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1、FPGA(FieldProgrammableGateArrays)是目前廣泛使用的一種可編程邏輯器件,FPGA的出現(xiàn)不僅使得ASIC(ApplicationSpecificIntegratedCircuits)產(chǎn)品的上市周期大大縮短、節(jié)省大量的開發(fā)成本,還彌補(bǔ)了PLD和ASIC之間的空白。本文針對(duì)復(fù)旦大學(xué)微電子研究院自主設(shè)計(jì)研究的名為FDP-3的FPGA芯片,使用VerilogHDL語言對(duì)其進(jìn)行建模。采用編寫Perl程序把網(wǎng)表文件直接轉(zhuǎn)
2、化成Verilog格式文件的方法,大大減少了工作量和出現(xiàn)手寫錯(cuò)誤的可能。模型在ModelSim軟件中進(jìn)行仿真驗(yàn)證。通過一個(gè)具體實(shí)例,證明本文建模方法和所建模型的正確。本文的另一工作是利用所建的VerilogHDL模型對(duì)FDP-3芯片的可編程邏輯資源的測(cè)試方法進(jìn)行了改進(jìn)。從FPGA最小的邏輯單元開始,設(shè)計(jì)了9種測(cè)試配置和對(duì)應(yīng)的測(cè)試向量對(duì)邏輯單元進(jìn)行完全充分的測(cè)試。經(jīng)TurboFault軟件驗(yàn)證,對(duì)邏輯資源的測(cè)試的故障覆蓋率可達(dá)100%。并
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