高速通信系統(tǒng)信號(hào)傳輸特性及其抖動(dòng)與噪聲分析.pdf

1、高速通信系統(tǒng)日益增長(zhǎng)的傳輸速率使得信號(hào)工作頻率節(jié)節(jié)攀升，傳輸線參數(shù)對(duì)信號(hào)傳輸性能的影響、印制電路板中抖動(dòng)和噪聲問題愈發(fā)突出，傳統(tǒng)電子設(shè)計(jì)方法和經(jīng)典傳輸線理論不再適用高速高集成度電子系統(tǒng)的研究。運(yùn)用信號(hào)完整性理論分析高速通信系統(tǒng)傳輸線特性、噪聲與抖動(dòng)具有重要意義。
　　首先從導(dǎo)體、介質(zhì)和返回路徑三個(gè)方面探討非均勻傳輸線對(duì)信號(hào)的影響。對(duì)導(dǎo)體建立了表面粗糙度模型，計(jì)算了其交流電阻、電抗;在構(gòu)建傳輸線電介質(zhì)無窮極點(diǎn)頻變模型的基礎(chǔ)上，探討了

2、介質(zhì)纖維交織結(jié)構(gòu)對(duì)特定長(zhǎng)度差分線的模式轉(zhuǎn)換影響;研究了平面分割槽線引起的信號(hào)衰減和電流串?dāng)_問題，并給出相應(yīng)的解決措施。
　　接著研究串行和并行信號(hào)抖動(dòng)和噪聲問題。以實(shí)際項(xiàng)目為背景，在前仿真中采用概率統(tǒng)計(jì)分析方法和雙狄拉克模型給出DDR3信號(hào)抖動(dòng)合理的概率分布，避免最大失真分析的悲觀估計(jì)，并在后仿真中利用Q變換的尾部擬合以提高分布函數(shù)尾部精度。研究了DDR3的時(shí)序分析方法，完成了抖動(dòng)、噪聲、時(shí)序的前預(yù)算和后驗(yàn)證的高速設(shè)計(jì)流程。

3、>　　建立傳輸線的無損電路模型，研究表明信道的寄生參數(shù)導(dǎo)致信號(hào)電壓差，造成信號(hào)抖動(dòng)。引入等效噪聲模型探索高速串行通信鏈路的碼間干擾產(chǎn)生機(jī)制，將離散的時(shí)序干擾量綜合為一個(gè)幅度噪聲值，形成新的評(píng)價(jià)視角;根據(jù)碼間干擾概率分布估算了包含均衡器的實(shí)例鏈路等效電壓噪聲，結(jié)合ANSYS Designer對(duì)高速串行系統(tǒng)進(jìn)行建模，多角度對(duì)比分析了不同均衡器的碼間干擾消除效果，并提供了一個(gè)新的碼間干擾等效電壓噪聲評(píng)價(jià)指標(biāo)。運(yùn)用統(tǒng)計(jì)分析方法對(duì)10Gbps差分