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文檔簡介
1、由于當今集成電路設(shè)計行業(yè)各個階段的相對獨立性,同時芯片設(shè)計與芯片制造過程分離的產(chǎn)業(yè)形式,導致攻擊者可能在芯片設(shè)計與制造環(huán)節(jié)中,將帶有特定惡意功能的“硬件木馬”電路植入到芯片內(nèi)部的硬件電路中。然而,集成電路芯片早已廣泛應用于國民經(jīng)濟的各個領(lǐng)域,一旦遭受“硬件木馬”攻擊,必給社會各方面帶來嚴重后果。
本課題首先根據(jù)AES算法原理,設(shè)計并優(yōu)化了一個128位的AES加密電路,并將其作為原始參考設(shè)計,在其中實現(xiàn)各種不同類型的硬件木馬,然
2、后從以下三個相對獨立的方向著手來探索數(shù)字IC設(shè)計領(lǐng)域中硬件木馬的特性與檢測方法:FPGA設(shè)計流程,首先在片上實現(xiàn)我們的原始AES加密設(shè)計以及植入有木馬的AES設(shè)計,然后利用NiosII軟核處理器搭建測試平臺,來進行AES模塊的測試以及其中硬件木馬的檢測;ASIC設(shè)計流程,通過完成原始AES加密模塊和植入有木馬的AES設(shè)計的后端實現(xiàn)并比較例如時鐘樹結(jié)構(gòu)之類的指紋信息、旁路信息,探索數(shù)字ASIC設(shè)計中檢測硬件木馬的潛在方法;電路的概率簽名理
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