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1、現(xiàn)有遙測(cè)設(shè)備信號(hào)源均采用市場(chǎng)直接購(gòu)買(mǎi)的通用信號(hào)源,成本高、體積大,且無(wú)法產(chǎn)生遙測(cè)設(shè)備所需幀格式的調(diào)制信號(hào)。隨著遙測(cè)設(shè)備任務(wù)密度的增加,現(xiàn)有檢測(cè)信號(hào)源已不能滿(mǎn)足實(shí)際需要。
本文研制的遙測(cè)設(shè)備檢測(cè)信號(hào)源,采用大規(guī)?,F(xiàn)場(chǎng)可編程門(mén)陣列(FieldProgrammable Gate Array,F(xiàn)PGA)技術(shù)和直接數(shù)字頻率合成(Direct DigitalFrequency Synthesizer,DDS)技術(shù),提出了信號(hào)源的總體設(shè)
2、計(jì)方案,其中包括硬件總體設(shè)計(jì)方案和軟件總體設(shè)計(jì)方案;以FPGA和DDS為核心器件,設(shè)計(jì)并實(shí)現(xiàn)了硬件電路,其中包括控制電路模塊、信號(hào)產(chǎn)生電路模塊、按鍵與顯示模塊、接口電路模塊、電源與晶振電路模塊等;采用VHDL語(yǔ)言完成了FPGA控制程序,實(shí)現(xiàn)了FPGA芯片對(duì)DDS芯片的操作與控制、參數(shù)配置以及產(chǎn)生信噪比可變的遙測(cè)信號(hào)的功能;采用VC6.0語(yǔ)言,設(shè)計(jì)了信號(hào)源計(jì)算機(jī)串口參數(shù)配置軟件,其中包括串口功能模塊、參數(shù)設(shè)置模塊、動(dòng)態(tài)信號(hào)模擬模塊、存盤(pán)功
3、能模塊、顯示模塊、定時(shí)模塊等模塊軟件;基于RS232接口協(xié)議,使用VHDL語(yǔ)言編寫(xiě)了數(shù)據(jù)通信協(xié)議模塊,實(shí)現(xiàn)了FPGA芯片與計(jì)算機(jī)之間的正常通信功能;采用高速碼率的直接序列擴(kuò)頻信號(hào)模擬高斯白噪聲,解決了噪聲信號(hào)的來(lái)源問(wèn)題;提出了檢測(cè)信號(hào)源的測(cè)試方法,并對(duì)信號(hào)源的技術(shù)性能指標(biāo)進(jìn)行了測(cè)試和驗(yàn)證,給出了測(cè)試結(jié)果,測(cè)試結(jié)果表明該信號(hào)源滿(mǎn)足總體設(shè)計(jì)的技術(shù)要求。
目前,該信號(hào)源已應(yīng)用于某型號(hào)遙測(cè)設(shè)備的靈敏度、遙測(cè)碼同步、分集合成器等性能
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