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1、在集成電路行業(yè)中,設(shè)計(jì)和測(cè)試是兩個(gè)不可分割的部分。隨著集成電路的規(guī)模越來越大,測(cè)試所占的成本也越來越高,至今已達(dá)到50%以上,測(cè)試時(shí)間是主要的因素。而其中,測(cè)試程序的開發(fā)直接影響著測(cè)試的時(shí)間。測(cè)試程序開發(fā)中的一個(gè)重要工作是將集成電路設(shè)計(jì)中產(chǎn)生的仿真文件編譯成可供測(cè)試的模式文件(pattern)。隨著器件的集成度和功能越來越復(fù)雜,仿真文件越來越龐大和復(fù)雜,編譯的時(shí)間也越來越長(zhǎng),所需的存儲(chǔ)資源和計(jì)算資源也越來越多。在實(shí)際應(yīng)用中,一臺(tái)SUN
2、Blade 150的工作站(擁有512M)內(nèi)存,編譯一個(gè)200M左右大小的仿真文件需要一個(gè)小時(shí)左右,且資源全部占用,不能做其他的工作。若仿真文件在1G以上,則要求配置強(qiáng)大的工作站,約需要十幾個(gè)小時(shí)才能完成編譯工作。而通常一塊芯片的仿真文件可以有幾十個(gè)甚至成百上千個(gè)。編譯這些文件是一項(xiàng)費(fèi)時(shí)費(fèi)力費(fèi)資源的工作。 GRID技術(shù)的出現(xiàn),解決了大規(guī)模計(jì)算的難題。網(wǎng)格充分利用閑置的計(jì)算資源和存儲(chǔ)資源,采用并行計(jì)算方法,可以大大縮短計(jì)算的時(shí)間。
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