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文檔簡介
1、隨著芯片集成度越來越高,系統(tǒng)功能越來越復(fù)雜,如何在設(shè)計初期就整體確定芯片的功能、評估芯片功耗和時序等方面的性能,成為芯片設(shè)計的關(guān)鍵問題之一。本文以兼容MCS51指令集的8位微控制器內(nèi)核為載體,研究基于SystemC的系統(tǒng)級建模技術(shù),以及8位微控制的寄存器級建模技術(shù),研究在系統(tǒng)級、RTL級的驗證與實現(xiàn)方法。
首先研究系統(tǒng)級建模技術(shù)。在充分研究8位微控制器體系結(jié)構(gòu)、功能特點,指令格式、指令尋址方式、指令執(zhí)行流程、指令執(zhí)行時序特
2、點等基礎(chǔ)上,研究基于SyetemC的系統(tǒng)級建模技術(shù),建立微控制器的主要部分的系統(tǒng)級模型,分別建立控制及數(shù)據(jù)通道模塊模型,及相應(yīng)的仿真環(huán)境。
其次,在RTL級設(shè)計8位微控制器,對其中的主要電路做優(yōu)化設(shè)計。通過分析電路結(jié)構(gòu)層次,采用不同的編碼風(fēng)格優(yōu)化譯碼器模塊,在FGPA上的綜合實現(xiàn)結(jié)果表明,優(yōu)化后的譯碼器的占用的資源比原譯碼器少43個ALUT,是原有資源的70.1％。
最后,研究MCU的驗證與實現(xiàn)技術(shù)。從系統(tǒng)、
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