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文檔簡介
1、本文設(shè)計(jì)了一種低功耗LVDS(Low Voltage Differential Signaling)收發(fā)集成電路。對比于傳統(tǒng)的發(fā)送電路，本次設(shè)計(jì)了片內(nèi)集成的共模反饋控制和邏輯使能控制，同時(shí)為了提高該電路的工作速度，還設(shè)計(jì)了一個(gè)電流補(bǔ)償電路來改善輸出的時(shí)延特性，使得其最高工作速率能達(dá)到622Mb/s。而在接收電路方面，該設(shè)計(jì)解決了傳統(tǒng)LVDS接收電路在共模信號輸入增大時(shí)性能不能滿足要求的問題。另外，該接收電路還支持失效保護(hù)(failsaf
2、e)功能和三態(tài)輸出功能。HSPICE仿真表明該LVDS接收電路在寬的共模輸入電壓范圍(0.1-2.4V)及低達(dá)100mV的差模輸入信號條件下均能穩(wěn)定工作。在400Mb/s的最高工作頻率下，靜態(tài)工作電流僅為1.2mA。該收發(fā)電路的各項(xiàng)設(shè)計(jì)指標(biāo)參照了部分商業(yè)芯片的數(shù)據(jù)手冊，并且在各種工藝、溫度、電源Eglti變化下均能穩(wěn)定工作，仿真性能接近并部分超過一些商用芯片。目前該收發(fā)一體芯片已經(jīng)通過華潤上華科技有限公N(CSMC)0.5umCMOS多
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