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1、大連海事大學(xué)大連海事大學(xué)畢業(yè)論文二○一四年六月二○一四年六月┊┊┊┊┊┊┊裝┊┊┊┊┊┊┊訂┊┊┊┊┊┊┊線┊┊┊┊┊I摘要摘要本文針對(duì)FPGA的計(jì)算器數(shù)字系統(tǒng)的設(shè)計(jì),進(jìn)行了軟件硬件的仿真與實(shí)現(xiàn)。實(shí)現(xiàn)了計(jì)算器控制系統(tǒng)的最基本的加減法功能設(shè)計(jì)。本設(shè)計(jì)所研究的數(shù)字系統(tǒng)是由四個(gè)不同的模塊完成的,包括鍵盤輸入模塊、譯碼模塊、計(jì)算主控制模塊以及數(shù)碼管顯示模塊。當(dāng)鍵盤輸入信號(hào)時(shí),依次通過這幾個(gè)模塊,完成數(shù)據(jù)的運(yùn)算及顯示。其中計(jì)算主控制模塊完成加減運(yùn)
2、算,是系統(tǒng)核心模塊。本設(shè)計(jì)利用EDA技術(shù),用VHDL語(yǔ)言來編程實(shí)現(xiàn)四個(gè)模塊的基本功能,在QuartusII軟件中實(shí)現(xiàn)模塊的設(shè)計(jì)、編譯、綜合、優(yōu)化、仿真直至生成器件之后下載到FPGA目標(biāo)芯片上。在ZY11EDA13BE實(shí)驗(yàn)系統(tǒng)中完成計(jì)算器控制系統(tǒng)的功能的實(shí)現(xiàn),通過鍵盤等操作輸入數(shù)值、運(yùn)算符號(hào),通過數(shù)碼管及指示燈顯示系統(tǒng)運(yùn)行結(jié)果,從而可以更清晰的觀察了計(jì)算器的運(yùn)行情況。關(guān)鍵詞:計(jì)算器;關(guān)鍵詞:計(jì)算器;EDAEDA;FPGAFPGA;Quar
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