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1、觸發(fā)器及其應(yīng)用實(shí)驗(yàn)報告 觸發(fā)器及其應(yīng)用實(shí)驗(yàn)報告 觸發(fā)器及其應(yīng)用實(shí)驗(yàn)報告 學(xué)生實(shí)驗(yàn)報告 院別 電子信息學(xué)院 課程名稱 電子技術(shù)實(shí)驗(yàn) 班級 無線技術(shù) 12 實(shí)驗(yàn)名稱 觸發(fā)器及其應(yīng)用 姓名 劉灼鵬 實(shí)驗(yàn)時間 2014 年 5 月 22 日 學(xué)號 2012010302032 指導(dǎo)教師 文毅 報 告 內(nèi) 容 一、實(shí)驗(yàn)?zāi)康暮腿蝿?wù) 1. 掌握基本 RS、JK、T 和 D 觸發(fā)器的邏輯功能。2. 掌握集成觸發(fā)器的功能和使用方法。3. 熟悉觸發(fā)
2、器之間相互轉(zhuǎn)換的方法。二、實(shí)驗(yàn)原理介紹 觸發(fā)器是能夠存儲 1 位二進(jìn)制碼的邏輯電路,它有兩個互補(bǔ)輸出端,其輸出狀態(tài)不僅與輸入有關(guān),而且還與原先的輸出狀態(tài)有關(guān)。觸發(fā)器有兩個穩(wěn)定狀態(tài),用以表示邏輯狀態(tài)“1”和“0”,在一定的外界信號作用下,可以從一個穩(wěn)定狀態(tài)翻轉(zhuǎn)到另一個穩(wěn)定狀態(tài),它是一個具有記憶功能的二進(jìn)制信息存儲器件,是構(gòu)成各種時序電路的最基本邏輯單元。1、基本 RS 觸發(fā)器 圖 14-1 為由兩個與非門交叉耦合構(gòu)成的基本 RS 觸發(fā)器,
3、它是無時鐘控制低電平直接觸發(fā)的觸發(fā)器?;?RS 觸發(fā)器具有置“0”、置“1”和保持三種功能。通常稱為置“1”端,因?yàn)?=0 時觸發(fā)器被置“1”;為置“0”端,因?yàn)?0 時觸發(fā)器被置“0”。當(dāng)==1 時狀態(tài)保持,當(dāng)==0 時為不定狀態(tài),應(yīng)當(dāng)避免這種狀態(tài)。由上式有:當(dāng) T=1 時, 當(dāng) T=0 時, 即當(dāng) T=1 時,為翻轉(zhuǎn)狀態(tài);當(dāng) T=0時,為保持狀態(tài)。4、D 觸發(fā)器 在輸入信號為單端的情況下,D 觸發(fā)器用起來更為方便,其狀態(tài)方程為:其
4、輸出狀態(tài)的更新發(fā)生在 CP 脈沖的上升沿,故又稱為上升沿觸發(fā)的邊沿觸發(fā)器,觸發(fā)器的狀態(tài)只取決于時鐘到來前 D 端的狀態(tài)。三、實(shí)驗(yàn)內(nèi)容和數(shù)據(jù)記錄 1、測試基本 RS 觸發(fā)器的邏輯功能 用兩個與非門組成基本 RS 觸發(fā)器,測試它的邏輯功能并畫出真值表將實(shí)驗(yàn)結(jié)果填入表內(nèi)。2、測試 JK 觸發(fā)器 74LS112 的邏輯功能 (1)測試 JK 觸發(fā)器的復(fù)位、置位功能 (2)測試 JK 觸發(fā)器的邏輯功能 (3)將 JK 觸發(fā)器的 J、K 端連在一起
5、,構(gòu)成 T 觸發(fā)器 在 CP 端輸入 1Hz 連續(xù)脈沖,觀察 Q 端的變化,用雙蹤示波器觀察 CP、Q 和的波形,注意相位關(guān)系,描繪之。(4)JK 觸發(fā)器轉(zhuǎn)換成 D 觸發(fā)器 按圖 14-4 連線,方法與步驟同上,測試 D 觸發(fā)器的邏輯功能并畫出真值表將實(shí)驗(yàn)結(jié)果填入表內(nèi)。四、實(shí)驗(yàn)結(jié)論與心得 通過這個實(shí)驗(yàn),可以知道,JK 觸發(fā)器在實(shí)際芯片中多了兩個輸入端,通過這兩個輸入端可以控制相同 JK 下的不同輸出。同時利用了低電平脈沖實(shí)現(xiàn)了當(dāng) JK
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