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1、I/Q基帶信號(hào)發(fā)生器可根據(jù)用戶的需求,產(chǎn)生指定調(diào)制格式的I/Q基帶信號(hào),廣泛應(yīng)用于通信、雷達(dá)、衛(wèi)星的設(shè)計(jì)和測(cè)試等領(lǐng)域。本文對(duì)I/Q基帶信號(hào)發(fā)生器的硬件電路進(jìn)行研究,主要完成的工作有:
(1)總體方案設(shè)計(jì)。分析了I/Q基帶信號(hào)發(fā)生器的組成,將其分成I/Q信號(hào)合成電路和I/Q信號(hào)調(diào)理電路兩部分。分析了I/Q信號(hào)合成電路的實(shí)時(shí)模式和任意波模式所需的功能模塊及其可實(shí)現(xiàn)性,確定了FPGA+DDR3 SDRAM+DAC的I/Q信號(hào)合成硬件
2、方案,通過FPGA內(nèi)用戶接口邏輯結(jié)合專用IP Core實(shí)現(xiàn)DDR3 SDRAM控制器,以及符號(hào)生成、調(diào)制映射、成形濾波、插值濾波、DDS等功能模塊,提高了硬件的集成度。研究了I/Q信號(hào)合成模塊輸出信號(hào)特點(diǎn),確定I/Q信號(hào)調(diào)理電路的方案,實(shí)現(xiàn)I/Q信號(hào)輸出形式變換、重構(gòu)濾波、幅度控制和偏移控制等功能。
(2)設(shè)計(jì)實(shí)現(xiàn)了I/Q基帶信號(hào)合成電路。分析了鏡像頻率與輸出帶寬和采樣率之間的關(guān)系,通過過采樣降低對(duì)DAC重構(gòu)濾波器的設(shè)計(jì)要求;
3、根據(jù) I/Q輸出信號(hào)幅度、相位、偏移準(zhǔn)確精細(xì)的要求,以800MSPS采樣率的雙通道DAC芯片AD9788為核心,構(gòu)建了數(shù)模轉(zhuǎn)換電路,并通過其內(nèi)部的寄存器控制實(shí)現(xiàn)插值、幅度精密控制和相位補(bǔ)償;分析了任意波模式讀寫速度和存儲(chǔ)容量要求,以DDR3 SDRAM芯片KVR13s9s8/4為核心構(gòu)建了波形數(shù)據(jù)讀寫電路,在FPGA內(nèi)控制器的控制下完成了任意 I/Q信號(hào)的合成;分析了 FPGA所需邏輯資源和 I/O引腳數(shù),并結(jié)合AD9788和KVR13
4、s9s8/4等外圍芯片對(duì)數(shù)據(jù)速率、電平標(biāo)準(zhǔn)、信號(hào)完整性的要求進(jìn)行了Bank的劃分和引腳的連接,在此基礎(chǔ)上實(shí)現(xiàn)了相關(guān)電路的設(shè)計(jì)。
?。?)設(shè)計(jì)實(shí)現(xiàn)了I/Q基帶信號(hào)調(diào)理電路。針對(duì)I/Q信號(hào)差分輸出的需求,設(shè)計(jì)了單端轉(zhuǎn)差分電路,為了減小電路冗余設(shè)計(jì)了差分轉(zhuǎn)單端電路;針對(duì)過渡帶窄、阻帶衰減大和線性相位的需求,分析比較了切比雪夫、巴斯特沃、貝塞爾、橢圓濾波器的特點(diǎn),采用9階橢圓濾波器的進(jìn)行重構(gòu)濾波;針對(duì)平坦幅頻響應(yīng)的需求,采用控制DAC輸
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