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文檔簡介
1、隨著數(shù)據(jù)采集系統(tǒng)的廣泛應(yīng)用,國內(nèi)與國外的技術(shù)水平仍存在一定的差距,研發(fā)一款具有自主知識(shí)產(chǎn)權(quán)的高速數(shù)據(jù)采集系統(tǒng)顯得越來越迫切,本論文課題背景是研究一款6GSPS采樣率、1GHz帶寬的高速數(shù)據(jù)采集卡,本論文主要研究的內(nèi)容是基于PCIe總線技術(shù)的高速AD采集卡的數(shù)據(jù)存儲(chǔ)與控制。
在硬件設(shè)計(jì)中,為了提高系統(tǒng)的采樣速率,采用兩片 ADC芯片時(shí)間并行交替采樣的方法。在可編程邏輯設(shè)計(jì)中,F(xiàn)PGA作為設(shè)計(jì)的主控模塊,采用模塊化的設(shè)計(jì)思路使用V
2、HDL語言實(shí)現(xiàn)對(duì)FPGA的控制,邏輯設(shè)計(jì)部分主要包括:基于SPI的串行通信設(shè)計(jì)實(shí)現(xiàn)時(shí)鐘芯片以及ADC芯片內(nèi)部寄存器的配置;使用FPGA內(nèi)部資源MIG控制核實(shí)現(xiàn)DDR2 SDRAM高速數(shù)據(jù)的存取和讀寫控制;數(shù)據(jù)采集卡與上位機(jī)的通信采用PCIe總線接口,使用可編程邏輯的器件Virtex5芯片生成PCIe端點(diǎn) IP核的方法實(shí)現(xiàn),從而大大縮短了開發(fā)周期,簡化了設(shè)計(jì)流程;設(shè)計(jì)基于DMA方式的PCIe總線傳輸,數(shù)據(jù)傳輸過程中,不需要占用CPU資源卻
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