基于CISC可配置多發(fā)射技術研究.pdf_第1頁
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文檔簡介

1、滿足眾核架構的單核處理器在性能、面積、功耗等方面都具有嚴格的設計要求。超標量技術的單核結構中，指令發(fā)射調度方法對程序執(zhí)行效率及芯片面積功耗都有較大影響;同時，針對不同嵌入式應用的可配置結構可加大多處理器集成的靈活性及應用范圍。
　　本文基于CISC架構在眾核中設計的要求完成CISC多發(fā)射結構優(yōu)化。在分析CISC指令特點的基礎上，對CISC指令進行類微碼的流水線執(zhí)行控制，并對只有單次Load或Store的簡單訪存指令進行拆分處理，以

2、助于提高流水線對CISC指令的執(zhí)行效率。優(yōu)化過程主要包括三個部分:首先，完成超標量雙發(fā)射的基礎結構設計及RTL實現(xiàn)。其次，在基本結構上研究雙發(fā)射優(yōu)化方法，分別從亂序執(zhí)行及CISC高頻執(zhí)行指令兩方面出發(fā)設計兩種優(yōu)化結構，并對這些結構進行可配置研究。最后，采用VerilogHDL基于精簡亂序雙發(fā)射優(yōu)化結構和針對簡單訪存高執(zhí)行頻度的多通路優(yōu)化結構。用C語言實現(xiàn)了處理器可配置設計方法和發(fā)射級的基本可配置結構。以上三種結構分別在TSMC65nm工

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