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文檔簡介
1、隨著人們生活水平的不斷提高,固定尺寸、單一畫面的視頻圖像顯示已經(jīng)無法滿足人們的視覺要求,超高清、超大分辨率的視頻畫面顯示以及多通道視頻信號融合已逐漸成為視頻顯示的主流。若單純使用軟件算法來實(shí)現(xiàn)這些功能,將會增加核處理器CPU的運(yùn)算時間和運(yùn)算量,因此本論文基于降低CPU處理數(shù)據(jù)的復(fù)雜度,提出了一種可在硬件平臺上實(shí)現(xiàn)高清視頻圖像實(shí)時輸出的設(shè)計方案。
論文以FPGA為核處理器,實(shí)現(xiàn)對視頻信號的實(shí)時處理及整體系統(tǒng)的邏輯功能控制。設(shè)計的
2、主要內(nèi)容是完成圖像縮放算法的硬件實(shí)現(xiàn),以及實(shí)現(xiàn)FPGA與外部存儲器間的高速視頻數(shù)據(jù)交互功能,首先通過MATLAB對縮放算法進(jìn)行仿真,在對圖像的質(zhì)量和可實(shí)時性進(jìn)行權(quán)衡的基礎(chǔ)上,選取一種能夠用硬件語言對其理論公式進(jìn)行行為級描述的插值算法。設(shè)計采用模塊化思想對系統(tǒng)進(jìn)行了劃分,在XILINX公司的開發(fā)工具ISE上使用硬件描述語言VerilogHDL進(jìn)行了模塊功能的實(shí)現(xiàn),并通過Isim前仿真驗(yàn)證了系統(tǒng)邏輯功能的正確性,然后通過布局布線、后仿真、時
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