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1、首先是針對(duì)RSA算法硬件實(shí)現(xiàn)部分的軟核設(shè)計(jì).在設(shè)計(jì)的過(guò)程中,完成了整體的結(jié)構(gòu)劃分,使用Verilog HDL硬件描述語(yǔ)言進(jìn)行了電路的RTL級(jí)描述,并利用了Candence公司的Verilog-XL完成了軟件平臺(tái)上的行為級(jí)仿真,實(shí)現(xiàn)了1024位數(shù)據(jù)的加密/解密的邏輯功能.RSA算法實(shí)現(xiàn)的軟核設(shè)計(jì)在應(yīng)用上具有很大的靈活性和獨(dú)立性,在接口模塊的配合下可以作為系統(tǒng)中獨(dú)立的加密/解密運(yùn)算部件,在微處理器的控制下使用,可以作為獨(dú)立的專(zhuān)用系統(tǒng)來(lái)使用.
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