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文檔簡介
1、隨著近年來半導(dǎo)體制造工藝的不斷進(jìn)步及電路的大規(guī)模化，集成電路設(shè)計中遇到了諸如功耗，時鐘偏移及連線延遲增大等難題。這時異步電路由于其低功耗，高性能及避免時鐘偏移等獨特優(yōu)勢引起了設(shè)計者的關(guān)注。對異步電路設(shè)計技術(shù)及單元電路的深入研究具有重要的理論意義及實踐價值。 論文針對目前集成電路設(shè)計中遇到的挑戰(zhàn)，介紹了異步集成電路的獨特優(yōu)勢、發(fā)展歷程及相關(guān)EDA工具。文中對異步電路設(shè)計技術(shù)的時序模式、編碼方式及信號協(xié)議作了研究，重點探討了四種異步
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