基于FPGA的數(shù)字濾波器設(shè)計(jì)與實(shí)現(xiàn).pdf_第1頁(yè)
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1、中圖分類號(hào)：TP274UDC：620密級(jí)：學(xué)校代碼：河北經(jīng)貿(mào)大學(xué)碩士學(xué)位論文(學(xué)歷碩士)公開(kāi)11832基于FPGA的數(shù)字濾波器設(shè)計(jì)與實(shí)現(xiàn)DesignandImplementationofDigitalFilterBasedonFPGA作者姓名：指導(dǎo)教師：學(xué)科專業(yè)名稱：論文完成日期：張景芝和志強(qiáng)教授計(jì)算機(jī)應(yīng)用技術(shù)2012年5月摘要本文針對(duì)采樣頻率為400M／s并行多路高速數(shù)據(jù)采集系統(tǒng)中的噪聲及干擾問(wèn)題，采用自上而下模塊化的設(shè)計(jì)方法，設(shè)計(jì)了

2、一個(gè)基于FPGA和分布式算法的32階系數(shù)可調(diào)數(shù)字濾波器，并對(duì)該數(shù)字濾波器進(jìn)行了具體的實(shí)現(xiàn)和仿真。研究工作主要包括以下幾個(gè)方面：(1)以數(shù)字濾波器的基本理論為依據(jù)，利用MATLAB的FDATools工具箱設(shè)計(jì)數(shù)字濾波器的濾波器系數(shù)，并對(duì)其進(jìn)行量化處理。(2)采用基于RAM查找表的分布式算法，實(shí)現(xiàn)了針對(duì)并行多路高速數(shù)據(jù)采集系統(tǒng)的32階系數(shù)可調(diào)數(shù)字濾波器的總體設(shè)計(jì)。(3)在QuartusII81環(huán)境下，運(yùn)用VHDL語(yǔ)言和圖形化設(shè)計(jì)相結(jié)合的方式

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