多內核cache一致性協(xié)議研究與實現(xiàn).pdf_第1頁
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文檔簡介

1、 集成電路設計以及制造業(yè)的不斷發(fā)展，使得在單個芯片上集成多個處理器內核成為了可能。由于多核處理器相對于單核處理器在功耗，速度等方面的優(yōu)勢，近年來得到了極大地發(fā)展。
在多核處理器中，多個內核對共享數(shù)據(jù)的訪問必將會引起數(shù)據(jù)沖突，也就是緩存（cache）出現(xiàn)不一致情況。cache 一致性協(xié)議就是為了解決這種不一致現(xiàn)象，使得內核可以實時訪問到正確的數(shù)據(jù)。
本文在分析了兩種傳統(tǒng)協(xié)議的基礎上提出了基于分層架構的混合一致性協(xié)

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