超寬帶(UWB)系統(tǒng)關(guān)鍵模塊的ASIC設(shè)計(jì)和低功耗優(yōu)化.pdf_第1頁
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文檔簡介

1、超寬帶(UWB,Ultra-Wideband)無線通信技術(shù)具有高傳輸速率、高分辨率、低功耗和抗干擾能力強(qiáng)等優(yōu)點(diǎn),成為學(xué)術(shù)界和產(chǎn)業(yè)界關(guān)注的研究熱點(diǎn)。其中,脈沖超寬帶技術(shù)在傳輸理論、性能和分析方法等方面與傳統(tǒng)通信技術(shù)不同,具有相當(dāng)多的優(yōu)點(diǎn)及研究價值。
   作為東南大學(xué)移動通信國家重點(diǎn)實(shí)驗(yàn)室國家863計(jì)劃課題“超寬帶SoC芯片設(shè)計(jì)及組網(wǎng)試驗(yàn)”的一部分,本文主要研究了脈沖超寬帶系統(tǒng)關(guān)鍵模塊的ASIC設(shè)計(jì)與低功耗優(yōu)化。
   本

2、文研究的高速采樣l -bit量化脈沖超寬帶系統(tǒng),其發(fā)送端設(shè)計(jì)和一般的脈沖UWB通信系統(tǒng)類似,但是在接收端,不對接收信號進(jìn)行多比特量化處理,而只通過比較器得到單一比特序列,從而降低需要存儲和處理的數(shù)據(jù)量。
   本學(xué)位論文圍繞高速采樣l-bit量化方式,在算法設(shè)計(jì)和RTL實(shí)現(xiàn)的同時,重點(diǎn)討論了系統(tǒng)發(fā)送和接收端關(guān)鍵模塊的ASIC設(shè)計(jì)與低功耗優(yōu)化過程。本文基于SMIC 0.13μm CMOS標(biāo)準(zhǔn)單元庫,使用Verilog HDL硬件描

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