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1、 當(dāng)前集成電路產(chǎn)業(yè)向深亞微米工藝不斷推進(jìn)，F(xiàn)PGA芯片布線時(shí)的面積約束便成為了影響整個(gè)芯片性能的最重要的因素之一，尤其是其關(guān)鍵線網(wǎng)布線時(shí)的布通率和面積約束是一對(duì)矛盾體。本文充分利用FPGA芯片本身具有的固定的規(guī)則的布線資源這一特點(diǎn)，提出在對(duì)每一個(gè)線網(wǎng)布線之前將待布的線網(wǎng)進(jìn)行關(guān)鍵性分析，再根據(jù)關(guān)鍵性大小對(duì)關(guān)鍵性相對(duì)大的線網(wǎng)進(jìn)行布線，即NCJ算法；此算法有效地在保證芯片性能的同時(shí)，提高了布線資源的利用率，同時(shí)考慮到深亞微米時(shí)布線時(shí)延是影響
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