基于C-C++的高層次綜合應(yīng)用研究.pdf_第1頁
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1、東南大學(xué)碩士學(xué)位論文基于CC的高層次綜合應(yīng)用研究姓名：李璐申請(qǐng)學(xué)位級(jí)別：碩士專業(yè)：電子科學(xué)與技術(shù)（集成電路設(shè)計(jì)）指導(dǎo)教師：時(shí)龍興20090604AbstractAbstractWiththerapiddevelopmentofElectronicDesignAutomationresearchollhigh—levelsynthesishasbecomeanotherhotspotinEDAresearchfieldThedesignp

2、eriodcanbegreatlyreducedbyusingHighlevelsynthesistechniqueSoitispossiblefordesignertosearchforthebestsolutionAlso，inordertomeettherezluirementoftime—tomarketandreducethedesigncostreuseofIPhasbeenanimportantmethodforICdes

3、ignTol】lakeIPreusepossible，ObjectOrientedProgramming(oov)techniqueofsoftware1ousecanbeusedforthedesignoftemplatealgorithmthroughraisingtheabstractdesignlevelfromRTLtoC／ClevelInthisthesis，byuseofaC，Cbaseddesignflowafullco

4、nfigurableCBCHencoder／decoder(CODEC)IPhasbeendesignedandsynthesizedtogenerateabytewiseprocessingBCH(4148，4096)CODECcircuitforerrorcorrectiononmultilevelcelI(MLC)NANDflashAseriesofparallelprocessingalgorithminBCHencoding／

5、decodingareanalyzedThendifferentarchitecturesarcachievedtoexplorethedesignspacebyCatapultCSynthesisofMentorGraphicsBasicmodulesandcriticalcomputationalelementsinthosearchitecturesareconstructedbyfunctions，classesandtempl

6、atesAndtheGFvariableandconstantmultiplierswhichareimplementedasfunctiontemplatesaremappedtobehighlevellibrarycellsbyCatapultCSynthesisTointegratemodulesintosystemhandshakeprotocolsareprovidedtotheinput／outputbyinterfaces

7、ynthesisTheC抖testbenchisreusedbyCatapulttodotheRTLsimulationandtheoutputsbetweenRTLandCarecomparedautomaticallyIntheendtheCH口issynthesizedtogeneratehi【ghqualityRTLforFPGAThedesignindicessuchasaroaanddelaycyclesofdifferen

8、tsolutionsareprovidedunderthedifferentconstraintsbytablestodothetrade—offComparedwithtraditionaldesignflowthedesigntimehasbeenreducedbyoV豇50％intheproposedflowwhichintegratesdesignverificationandsynthesisBCHCODEC11i醛beeni

9、ntegratedintoSOCplatformandthecorrespondingFPGAprototypeisconstructed011AlteraStraitixⅡEP2S90F1020C5TheresultofverificationdernonslratcsthattheCODECreachestheexpecteddesignobjective，andthethroughputcanbeupto40MB／sinthebe

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