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1、太原理工大學(xué)碩士學(xué)位論文VHDL并行模擬算法的研究姓名:孫秀麗申請(qǐng)學(xué)位級(jí)別:碩士專業(yè):計(jì)算機(jī)應(yīng)用指導(dǎo)教師:謝紅薇20020101AbstractAsthetechnologicallevelofLSIandVtSIsteadilYdevelopment,thescaleandthecomplexityofdigita]systemareexpandedatveryhighspeedSo,itiSveryimportantmeanings
2、toofferakindoffastandhigh—effiCientlogicSimulationsystemfordesigningandmakingthedigitalsystemPeoplemostlyadoptVHDLlanguageindesigningandsimulationdigitalsystemButthehugesealeofdesignandthelanguagecomplexityofitseifleadto
3、theproblemsofdifficultdeveloping,SlowlyrunspeedandheavilYtakingspaceoftheSimulatorThespeedofSimulatordependsonthesimulationalgorithmandexecutivetechniqueOnbaseoftheviewoftimeandspace,peopleproposedlotsofsoftwareandhardwa
4、remethod,whichimprovedthespeedofSimulationfromdifferentlevelandsolredsomeproblemexistedinsimulationsystemThiSpapermainlyintroducedistributionandparallelVHDLSimulationwhichuselotsof“processorstoparallelSimulateVHDLmodelCi
5、rcuitaccordingtothepara]lelcharacteristicofcircuititselfSothiSmethodcangreatlyimproveSimulationspeedHowever,furtherresearchiSneededThiSpaperputsforwardaparallelSimulationalgorithmcombiningalocalnetworkandPVMparalle]softw
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