基于FPGA的Turbo碼硬件設計及性能分析.pdf_第1頁
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文檔簡介

1、隨著通信技術的高速發(fā)展以及軍事與民用兩方面對傳輸信息的更高要求，當今的糾錯碼技術已經不能僅僅在理論上探討問題，必須進一步的提升到實際應用當中去，并且已經成為大部分通信系統(tǒng)中不可或缺的一項關鍵技術。 本文介紹了Turbo碼編碼系統(tǒng)的結構，針對Furbo碼的特點，重點研究了系統(tǒng)遞歸卷積碼(RSC)和交織器的特點及二者在Turbo碼中的作用。接著對譯碼系統(tǒng)的結構也進行了介紹，重點在迭代譯碼中進行了研究，并提出了利用外部信息和交叉熵聯合

2、作為迭代停止準則的新算法，通過仿真達到了預期效果。 針對實際應用環(huán)境對整個編譯碼系統(tǒng)以及信道進行了軟件的模型搭建和軟件仿真，在仿真中根據實際通信要求做了具體的參數設定，得出了仿真結果，并對仿真結果進行了進一步的分析和不同參數的性能比較。在軟件仿真的基礎上，我們以FPGA做為核心芯片設計出Turbo碼譯碼系統(tǒng)的硬件實現電路，由于Turbo碼譯碼時需要大量的存儲空間作為迭代的中間信息，我們提出利用外部存儲器作為暫存迭代信息的介質，這

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