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文檔簡介
1、近年來,隨著集成電路工藝的進步以及集成電路技術(shù)在通訊應用領域的不斷發(fā)展,微處理器和無線通訊設備的工作頻率都越來越高,這就對數(shù)模信號的傳輸與轉(zhuǎn)換提出了更高的要求,高速度、高精度數(shù)模轉(zhuǎn)換器的設計也因而變得更具挑戰(zhàn)性.針對這方面的需求,本論文研究并設計了一款高速度、高精度的數(shù)模轉(zhuǎn)換器. 首先,論文在理論分析和電路設計的基礎上,重點研究了數(shù)模轉(zhuǎn)換器DAC和帶隙基準電路兩部分關鍵內(nèi)容.通過比較不同結(jié)構(gòu)DAC的優(yōu)缺點,結(jié)合設計指標要求,確定
2、分段式電流舵結(jié)構(gòu).在綜合考慮芯片的面積、電路的復雜程度、性能指標的優(yōu)劣等各方面因素之后,使用5+4+5的分段結(jié)構(gòu)可以實現(xiàn)單位電流源與二進制加權(quán)電流源的最優(yōu)化組合.此外,本文從電路結(jié)構(gòu)和版圖兩方面對影響DAC主要性能的各個關鍵因素進行了深入研究與討論. 其次,論文對DAC的前仿真、版圖設計、物理驗證(DRC/LVS)以及后仿真等方面進行了討論.在Cadence ADE環(huán)境下采用SMIC 0.35μm CMOS工藝庫完成了芯片的仿真
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