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文檔簡介
1、在當今高速信號處理技術(shù)中，DSP＋FPGA方式是目前比較先進的實現(xiàn)途徑和有效解決手段?，F(xiàn)場可編程邏輯陣列(FPGA)是一種由用戶自行配置的高密度通用數(shù)字集成芯片，具有小型化、低功耗、可編程、數(shù)字化和快速方便實用的特點。FPGA適合完成高效、算法固定的任務；DSP適合完成結(jié)構(gòu)復雜的算法。本文中的雷達信號處理和控制系統(tǒng)就是采用DSP＋FPGA的方式。信號處理系統(tǒng)采用的是Xilinx公司的Virtex-Ⅱ系列vc2v3000FPGA芯片和多片
2、AnalogDevices公司的TigerSHARCTS101的硬件電路結(jié)構(gòu)。
隨著高速AD變換和DSP技術(shù)的發(fā)展，數(shù)字中頻接收技術(shù)將是提高現(xiàn)代雷達性能的重要技術(shù)之一。模擬正交接收機由于受模擬電路的限制，其IQ幅相誤差較大，而IQ的幅相誤差會嚴重影響雷達的整機性能，為改善IQ兩路信號的正交質(zhì)量，往往需要進復雜的校正處理。數(shù)字中頻技術(shù)利用中頻直接采樣，經(jīng)過數(shù)字信號處理獲得視頻IQ信號，其具有IQ鏡像抑制比高、線性動態(tài)范圍大、體積
3、小、重量輕、一致好等優(yōu)點，是現(xiàn)代高性能雷達的發(fā)展方向。本文采用高精度的ADC芯片完成中頻采樣，采用多相濾波的方式實現(xiàn)直接數(shù)字正交。
本文主要內(nèi)容是：基于FPGA＋DSP的雷達信號處理板，設計完成單脈沖雷達三路中頻信號數(shù)字化處理系統(tǒng)的研制。本文基于FPGA提出了兩種雷達中頻信號數(shù)字化處理設計與實現(xiàn)方案，且完成兩種方案的設計與實現(xiàn)，以便于兩種設計方案的性能對比。
首先根據(jù)設計要求和FPGA芯片資源論證了雷達中頻信號數(shù)字化
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