嵌入式流水線型模數(shù)轉(zhuǎn)換器的研究.pdf_第1頁
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1、本文在分析流水線型MD轉(zhuǎn)換器設(shè)計(jì)中常用的1.5位/級(jí)結(jié)構(gòu)的基礎(chǔ)上，研究了開關(guān)—電容結(jié)構(gòu)的采樣/保持電路設(shè)計(jì)以及數(shù)字校正電路設(shè)計(jì)，設(shè)計(jì)了一個(gè)10位/20MSPS流水線型A/D轉(zhuǎn)換器。主要工作內(nèi)容如下： 1、采用數(shù)字校正電路防止由于比較器失調(diào)對(duì)模數(shù)轉(zhuǎn)換器分辨率的限制，數(shù)字校正電路使轉(zhuǎn)換器對(duì)比較器失調(diào)誤差的容忍能力更高。在沒有數(shù)字校正電路時(shí)，比較器失調(diào)不能超過模數(shù)轉(zhuǎn)換器的1LSB，通過數(shù)字校正電路，可以使用更加簡(jiǎn)單的比較器，從而可以減

2、小功耗，節(jié)約芯片面積，同時(shí)可以實(shí)現(xiàn)更高分辨率的模數(shù)轉(zhuǎn)換器。本論文設(shè)計(jì)的數(shù)字校正電路是利用一個(gè)簡(jiǎn)單的移位寄存器和邏輯門電路來實(shí)現(xiàn)，使電路結(jié)構(gòu)更加簡(jiǎn)單。 2、在本論文的設(shè)計(jì)中，輸入的原始信號(hào)和SUB-DAC電路輸出模擬量分別做兩倍運(yùn)算后再進(jìn)行減法運(yùn)算，最后得到余差輸出信號(hào)，這樣使電路更加簡(jiǎn)化。 3、采用CHARTERED0.35μm、四層金屬、雙多晶硅CMOS工藝參數(shù)和設(shè)計(jì)規(guī)則對(duì)一個(gè)10位/20MSPS流水線型結(jié)構(gòu)A/D轉(zhuǎn)換

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