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文檔簡介
1、隨著處理技術(shù)的大規(guī)模進步,SoC系統(tǒng)對片上存儲器延時和帶寬的要求越來越高,這樣一來存儲系統(tǒng)成為了主要的性能限制瓶頸。面臨復(fù)雜的存儲系統(tǒng)設(shè)計時,傳統(tǒng)的仿真模型建模過程復(fù)雜,仿真速度慢,已經(jīng)無法滿足需求。提高系統(tǒng)設(shè)計的抽象層次,系統(tǒng)級設(shè)計成為解決問題的必要方案。利用數(shù)學(xué)方法建立解析建模對存儲系統(tǒng)進行研究,可以量化分析影響存儲系統(tǒng)性能的因素,并大大減少了性能評估驗證時間,具有靈活性高、仿真速度快的特點。
本文主要針對DDR存儲系統(tǒng)進
2、行高層性能評估,重點研究DDR存儲系統(tǒng)的訪存延時和帶寬,對其進行解析建模并評估性能?,F(xiàn)存的存儲系統(tǒng)訪存延時解析建模未能全面分析訪存請求流程,導(dǎo)致得到的訪存延時誤差較大。本文根據(jù)訪存請求服務(wù)流程全面分析DDR存儲系統(tǒng)的訪存延時,充分考慮訪存延時的組成成分,將訪存延時分為DDR存儲控制器延時和DDR存儲器延時兩個部分進行建模。DDR存儲控制器延時的主要成分是訪存請求的排隊延時,本文根據(jù)排隊模型的輸入過程、排隊規(guī)則和服務(wù)機制三大特性建立了存儲
3、系統(tǒng)訪存請求的M/D/1排隊模型來進行性能分析。根據(jù)DDR訪存請求的訪存模態(tài),即行緩沖命中和行緩沖未命中評估存儲器服務(wù)時間和DDR存儲器延時,最終建立了訪存延時的解析模型。對于訪存帶寬的建模,本文使用DDR效率對訪存帶寬進行評估,通過分析訪存請求地址蹤跡,收集時序參數(shù),計算DDR效率。最后,將解析模型所得性能參數(shù)與基于DRAMSim2仿真器的仿真結(jié)果進行比較,評估解析模型的適用性和精確性。實驗表明,與仿真模型結(jié)果相比,在不同實驗配置下,
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