SOC存儲子系統(tǒng)高層建模及DDR控制器訪存調(diào)度策略的研究和設(shè)計.pdf_第1頁
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文檔簡介

1、隨著處理器和存儲器性能增長速度的差距逐漸增大，存儲器性能的好壞逐漸成為影響SOC系統(tǒng)性能的重要因素。優(yōu)化DDR控制器訪存調(diào)度算法和DDR控制器頁策略是改進(jìn)DDR存儲器性能的關(guān)鍵，設(shè)計合理的訪存調(diào)度算法和頁策略將很大程度上優(yōu)化SOC系統(tǒng)的性能。本文將在SOC存儲子系統(tǒng)高層建模的基礎(chǔ)上優(yōu)化DDR控制器訪存調(diào)度算法，SOC存儲子系統(tǒng)高層建模使用美國馬里蘭大學(xué)開發(fā)的開源模擬器DRAMSim2。
　　本文通過對其源代碼進(jìn)行修改裁剪，在DRA

2、MSim2原有輪詢調(diào)度算法基礎(chǔ)上，增加優(yōu)先級調(diào)度策略，形成基于輪詢機制的優(yōu)先級調(diào)度算法，改進(jìn)原始DRAMSim2版本中僅支持固定開頁和閉頁的頁策略，實現(xiàn)了動態(tài)開閉頁切換的功能。針對基于輪詢機制的訪存調(diào)度算法存在的問題，將輪詢調(diào)度算法和優(yōu)先級調(diào)度算法的特點結(jié)合，在DRAMSim2中設(shè)計實現(xiàn)了基于輪詢機制的優(yōu)先級調(diào)度算法，DDR控制器的訪存性能得到顯著提升，改進(jìn)的基于輪詢機制的優(yōu)先級調(diào)度算法對系統(tǒng)延遲性能的提升在15-30％。針對DRAMS

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