基于FPGA的IRIG_B編解碼系統(tǒng)設(shè)計(jì)與實(shí)現(xiàn).pdf_第1頁
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文檔簡介

1、“時(shí)間統(tǒng)一系統(tǒng)”主要是指能夠提供標(biāo)準(zhǔn)時(shí)間信號和頻率信號的整套電子設(shè)備，被廣泛的應(yīng)用于航天，衛(wèi)星，導(dǎo)航以及通信等多個(gè)領(lǐng)域。
　　 本文首先討論了“時(shí)間統(tǒng)一系統(tǒng)”的理論和發(fā)展，進(jìn)而闡明了IRIG_B（美國靶場儀器組_B）編解碼的原理，在此基礎(chǔ)上完成了一種基于FPGA技術(shù)的IRIG_B編解碼系統(tǒng)硬件實(shí)現(xiàn)方法。
　　 本文采用Altera公司具有最新FPGA技術(shù)的DE2-115開發(fā)系統(tǒng)來完成時(shí)統(tǒng)終端的設(shè)計(jì)，并從工程實(shí)踐的角度詳細(xì)

2、介紹了編解碼系統(tǒng)的設(shè)計(jì)方案。1、編碼器部分采用硬件邏輯電路和調(diào)用IP核的方法，利用高性能的FPGA實(shí)現(xiàn)。保證了IRIG_B碼與IPPS基準(zhǔn)信號的上升沿同步，提高了準(zhǔn)確性和穩(wěn)定性。2、解碼器部分利用NiosII嵌入式軟核處理器構(gòu)建SOPC系統(tǒng)來實(shí)現(xiàn)，達(dá)到軟硬件協(xié)同工作的效果，簡化了控制功能同時(shí)節(jié)省了資源。3、整個(gè)設(shè)計(jì)將IRIG_B編解碼器集成到同一塊FPGA芯片上，使得設(shè)備同時(shí)具備編解碼功能，具有更高的實(shí)用價(jià)值同時(shí)簡化了系統(tǒng)的測試。4、本

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