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文檔簡介
1、隨著芯片面積的縮小、運(yùn)算速率的提高和通信帶寬的增加,日益突出的功耗問題逐漸成為制約NoC發(fā)展的關(guān)鍵因素之一。NoC的功耗主要來自于路由單元功耗和網(wǎng)絡(luò)互聯(lián)功耗,因此設(shè)計(jì)出低功耗路由單元對降低NoC功耗有著重要的現(xiàn)實(shí)意義。
本文的主要工作是研究片上網(wǎng)絡(luò)路由單元的可配置設(shè)計(jì)思想和低功耗設(shè)計(jì)技術(shù),并在Synopsys公司的EDA環(huán)境下使用Verilog HDL語言設(shè)計(jì)出適用于2D Mesh、Torus、Fat-Tree和Butte
2、rfly Fat-Tree等網(wǎng)絡(luò)的虛通道數(shù)目和緩存深度均可配置的低功耗路由單元,最終通過搭建片上通信網(wǎng)絡(luò)進(jìn)行路由單元的功能驗(yàn)證和性能分析。
本文首先討論了路由單元設(shè)計(jì)的關(guān)鍵技術(shù)和NoC低功耗技術(shù),在此基礎(chǔ)上,給出了低功耗可配置的路由單元設(shè)計(jì)方案。在路由單元可配置設(shè)計(jì)中,采用了虛擬通道技術(shù)降低阻塞的發(fā)生概率;并且將輸入端口虛通道數(shù)目和緩存深度設(shè)計(jì)為可配置參數(shù);采用了改進(jìn)的源路由算法,結(jié)合基于優(yōu)先級的Lottery仲裁機(jī)制,一
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