2023年全國(guó)碩士研究生考試考研英語(yǔ)一試題真題（含答案詳解+作文范文）_第1頁(yè)
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文檔簡(jiǎn)介

1、本文完成了函數(shù)信號(hào)發(fā)生器的設(shè)計(jì)，設(shè)計(jì)過(guò)程利用了多種設(shè)計(jì)方法和開(kāi)發(fā)環(huán)境，克服了傳統(tǒng)方法的缺點(diǎn)，使得設(shè)計(jì)過(guò)程更加高效、便捷。本文采用直接數(shù)字頻率合成技術(shù)，以FPGA(現(xiàn)成可編程門陣列)為硬件基礎(chǔ)，通過(guò)基于FPGA的現(xiàn)代DSP系統(tǒng)設(shè)計(jì)方法完成了信號(hào)發(fā)生器的核心模塊，并利用基于NiosⅡ軟核的SOPC系統(tǒng)設(shè)計(jì)方法完成了整個(gè)項(xiàng)目的軟硬件設(shè)計(jì)。
　　 論文首先概述了信號(hào)發(fā)生器的研究背景及DDS原理，然后著重介紹了DDS模塊的設(shè)計(jì)，信號(hào)發(fā)生器

2、的核心是DDS模塊，論文根據(jù)DDS原理，在Matlab/Simulink環(huán)境下對(duì)DDS信號(hào)發(fā)生模塊進(jìn)行了設(shè)計(jì)和仿真，再配合DSPBuilder中的編譯功能使圖形化建立的模塊轉(zhuǎn)換成為可以在QuartusⅡ軟件中可以使用的VHDL文件，并最終在QuartusⅡ環(huán)境中生成符號(hào)，從而實(shí)現(xiàn)設(shè)計(jì)模塊在FPGA上的實(shí)體化，使之成為整個(gè)NiosⅡ系統(tǒng)的一個(gè)模塊。該DDS模塊可生成多種信號(hào)波形，實(shí)驗(yàn)結(jié)果表明，通過(guò)控制該模塊可實(shí)現(xiàn)基本波形及調(diào)制波形的產(chǎn)生，

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