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1、我們大規(guī)模集成電路研究所與美國著名EDA公司Avanti合作,主要研究數(shù)字集成電路中的邏輯綜合和優(yōu)化問題.而在集成電路的各項(xiàng)參數(shù)優(yōu)化中,如何使電路速度達(dá)到用戶暨定的目標(biāo)則是首要任務(wù).一般將邏輯電路速度優(yōu)化分為時序優(yōu)化方法和組合優(yōu)化方法,而基于avanti公司提出的希望對原有的電路速度優(yōu)化30﹪的要求,我們項(xiàng)目組準(zhǔn)備采用的是組合優(yōu)化+時序優(yōu)化的方法.我在主要研究了集成電路速度優(yōu)化中的時序優(yōu)化方法—retiming算法.一般介紹的retim
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