可重構(gòu)流水陣列系統(tǒng)的研究與實(shí)現(xiàn).pdf_第1頁
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文檔簡(jiǎn)介

1、本文描述了一種基于可重構(gòu)流水線陣列的系統(tǒng)—(RPAS-Reconfigurable Pipelined Array System),該陣列系統(tǒng)適用于大計(jì)算量的數(shù)字信號(hào)處理領(lǐng)域,比如視頻編解碼,通過AHB接口與ARM核進(jìn)行通信,輔助處理器完成大規(guī)模的運(yùn)算操作。本文描述了這一陣列系統(tǒng)的結(jié)構(gòu),RPAS結(jié)構(gòu)擁有兩個(gè)個(gè)突出優(yōu)點(diǎn):第一:陣列按列配置,每列的配置字對(duì)應(yīng)流水線的某一級(jí),對(duì)應(yīng)流水線各級(jí)的配置字通過路由單元傳輸?shù)街付ǖ牧欣?通過控制路由單元

2、就可以實(shí)現(xiàn)陣列的動(dòng)態(tài)配置,相比較與主處理器控制逐列輸入配置字的方式,配置字路由方式降低了主處理器的負(fù)荷。第二:根據(jù)對(duì)大量常見的數(shù)字信號(hào)處理算法的研究,陣列采用了簡(jiǎn)化的處理單元互聯(lián)方式,以及對(duì)不同列采用異構(gòu)的處理單元,降低了系統(tǒng)的面積與復(fù)雜度。最后介紹在H.264編解碼過程中運(yùn)行次數(shù)多,耗時(shí)長(zhǎng)的2維DCT運(yùn)算和求塊的SAD值運(yùn)算在RPAS中的映射與實(shí)現(xiàn)。仿真結(jié)果顯示,RPAS能達(dá)到6倍以上于通用處理器的性能,并在運(yùn)算實(shí)現(xiàn)復(fù)雜度與芯片面積之

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