低截獲混合擴(kuò)頻接收機(jī)設(shè)計(jì)及FPGA實(shí)現(xiàn).pdf_第1頁(yè)
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1、寬帶、高速跳頻和直接序列擴(kuò)頻相結(jié)合的混合擴(kuò)頻系統(tǒng)具有較強(qiáng)的抗截獲能力和抗干擾能力。
　　本文給出了一種截獲概率很低的混合式擴(kuò)頻通信系統(tǒng)接收機(jī)方案,進(jìn)行了硬件結(jié)構(gòu)設(shè)計(jì),完成了相關(guān)模塊的FPGA實(shí)現(xiàn),具體工作如下:
　　1.針對(duì)系統(tǒng)的突發(fā)性和低截獲性,本文提出了一種長(zhǎng)碼實(shí)時(shí)捕獲方案;設(shè)計(jì)了一種基于循環(huán)碼移鍵控(CCSK)的高階M元解擴(kuò)和遲早環(huán)同步跟蹤方案;給出了系統(tǒng)相關(guān)接口。
　　2.完成了相關(guān)模塊的FPGA實(shí)現(xiàn),包括:基

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