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1、本文主要介紹FPGA的實(shí)際應(yīng)用。在第一部分設(shè)計(jì)出一種新的基于提升算法的二維離散小波變換的硬件結(jié)構(gòu)，在這種結(jié)構(gòu)中采用了折疊技術(shù)和流水線技術(shù)，折疊技術(shù)的采用極大的提高了硬件的利用率，而流水線技術(shù)的引入可以提高系統(tǒng)的時鐘頻率，從而提高了小波變換的效率。最后對該結(jié)構(gòu)采用Verilog HDL編碼實(shí)現(xiàn)，并在Quartus II 5.0 平臺上成功的進(jìn)行仿真。 文章的第二部分主要利用FPGA構(gòu)建了一個可編程片上系統(tǒng)（SOPC），該系統(tǒng)能通過
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