數(shù)字陣列雷達(dá)DBF處理器的設(shè)計與實(shí)現(xiàn).pdf_第1頁
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文檔簡介

1、隨著微波集成電路、超大規(guī)模與超高速集成電路、光纖傳輸技術(shù)的發(fā)展,全數(shù)字化的數(shù)據(jù)處理和數(shù)字波束形成技術(shù)成為當(dāng)代數(shù)字陣列雷達(dá)技術(shù)的一個發(fā)展趨勢。數(shù)字波束形成(DBF)處理器作為數(shù)字陣列雷達(dá)的核心組成部分,成為了國內(nèi)外雷達(dá)領(lǐng)域研究的熱點(diǎn)。
   本文針對某數(shù)字陣列雷達(dá)系統(tǒng)的項目研制需求,設(shè)計并研制了一種以2片F(xiàn)PGA和一片PowerPC為核心架構(gòu)的DBF處理器。完成了DBF處理器的FPGA軟件的設(shè)計、仿真、驗證,并和專用DBF測試模擬

2、器進(jìn)行聯(lián)調(diào)驗證DBF處理器的基本功能。所設(shè)計DBF處理器具有以下特性:
   (1)12通道3.125Gbps光纖傳輸接口。強(qiáng)大的數(shù)據(jù)傳輸能力能夠滿足DBF系統(tǒng)龐大數(shù)據(jù)吞吐量的需求。
   (2)高速并行數(shù)據(jù)存儲和計算能力。采用Xilinx公司的XC5VSX330T芯片具有大量的邏輯、存儲和計算資源,能夠?qū)崿F(xiàn)100個陣元的12個接收波束和4個發(fā)射波束的實(shí)時DBF處理。
   (3)10Gbps的SerialRap

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