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文檔簡介
1、在芯片設(shè)計規(guī)模和復(fù)雜度不斷增大的今天，數(shù)據(jù)顯示有一半到三分之二的SoC項目在第一次流片時失敗，而功能缺陷的存在是其中主要原因。功能驗證已經(jīng)成為數(shù)字芯片開發(fā)的瓶頸。
本文的主要內(nèi)容是利用SystemVerilog語言，搭建一個基于VMM(VerificationMethodology Manual)驗證方法學(xué)的緩存管理(BA，Buffer Administer)模塊的驗證平臺。本文首先研究了一種基于重用性的層次化的驗證架構(gòu)，
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