對象存儲控制器的硬件設(shè)計與實現(xiàn).pdf_第1頁
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文檔簡介

1、隨著存儲需求的增加及存儲應(yīng)用日益復(fù)雜,以塊為基礎(chǔ)的存儲接口已限制了存儲系統(tǒng)的發(fā)展,以對象為基礎(chǔ)的存儲接口應(yīng)運而生。對象級接口是塊級接口和文件級接口的完美結(jié)合,具有安全性、跨平臺操作性、高性能和智能化的特點,但是對象級接口智能化的管理和復(fù)雜存儲協(xié)議的解析使對象存儲控制器的負荷加重,為了提高對象存儲系統(tǒng)的性能,對對象存儲控制器的硬件設(shè)計進行了研究。 采用Xscale微架構(gòu)處理器和交換式架構(gòu)實現(xiàn)對象存儲控制器。Xscale微架構(gòu)處理器

2、是一種RISC(Reduced Instruction Set Computer)型微處理器,具有結(jié)構(gòu)簡單、處理速度快、處理功能強和低功耗等優(yōu)點,非常符合對象存儲控制器的要求。而交換式架構(gòu)解決了I/O總線的瓶頸,實現(xiàn)并行I/O,同時交換式芯片集成多種接口以節(jié)省PCB(Printed Circuit Board)板的空間,簡化設(shè)計。對象存儲控制器的處理器模塊、內(nèi)存模塊和Flash模塊組成最小系統(tǒng),是對象存儲控制器的核心,而時鐘模塊、電源模

3、塊和電源監(jiān)控模塊的正確設(shè)計是實現(xiàn)最小系統(tǒng)正常工作的必備條件。 隨著集成電路的發(fā)展,芯片的體積越來越小,電路的布局布線密度越來越大,信號的工作頻率也越來越高,硬件設(shè)計時需考慮高速電路的傳輸線效應(yīng)和信號完整性。對象存儲控制器屬于高速電路的范疇,PCB實現(xiàn)時分別從疊層設(shè)計、布局、電源完整性、阻抗匹配和串?dāng)_等方面解決了信號完整性問題,并基于IBIS(I/O Buffer Information Specification)模型進行信號完

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