2023年全國碩士研究生考試考研英語一試題真題(含答案詳解+作文范文)_第1頁
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文檔簡介

1、全球數(shù)字化視頻信號處理及便攜式通信技術(shù)等領(lǐng)域的快速發(fā)展,促使高性能A/D轉(zhuǎn)換器的研究成為當(dāng)務(wù)之急。基于對10-bit100MSPSPipelinedCMOSADC系統(tǒng)結(jié)構(gòu)的分析研究,結(jié)合系統(tǒng)性能確定了子ADC的指標要求,詳細討論并設(shè)計了子ADC單元模塊的設(shè)計,包括預(yù)放大鎖存比較器,參考電阻串和時鐘控制編碼電路。 首先,根據(jù)第一級2.5位/級,中間五級1.5位/級,最后一級3位/級的七級流水線ADC系統(tǒng)結(jié)構(gòu)分析,并結(jié)合預(yù)期總體性能

2、指標,分析了系統(tǒng)對子ADC的指標限制。 其后,在具體的子ADC設(shè)計中,對比各比較器類型的優(yōu)缺點,并基于預(yù)放大鎖存快速比較理論,提出一種新型高速低功耗預(yù)放大鎖存比較器電路拓撲;根據(jù)ADC系統(tǒng)所允許的參考電壓最大波動限制,在回饋噪聲對輸入?yún)⒖茧娖降挠绊懞凸闹g折衷,確定優(yōu)化的參考電阻串阻值;根據(jù)不同級精度的編碼要求,設(shè)計出時鐘控制編碼電路。在具體電路設(shè)計中,不僅充分考慮了噪聲、失調(diào)和失配等非理想因素,而且在實現(xiàn)系統(tǒng)對子ADC的指標

3、限制前提下,降低了功耗。 然后,應(yīng)用典型0.35μm/3.3V硅CMOS工藝模型,通過Cadence模擬軟件進行模擬仿真。結(jié)果表明,該新型預(yù)放大鎖存比較器延遲時間231ps,功耗118.6μW。將該比較器應(yīng)用于不同級精度子ADC時,各級子ADC都能在100MSPS的采樣頻率下正確工作,最小可分辨電壓達到10mV,建立時間不超過1.2ns;當(dāng)參考電阻串阻值優(yōu)化為1KQ時,其回饋噪聲對輸入信號和電阻串參考電壓產(chǎn)生的毛刺峰值分別是6.

4、35mV,1.57mV;各級子ADC的總功耗為5.57mW??芍M結(jié)果完全滿足ADC系統(tǒng)對這些子ADC單元模塊的預(yù)定指標。當(dāng)子ADC和構(gòu)成ADC的其他模塊進行系統(tǒng)仿真,采樣頻率為100MSPS時,ADC系統(tǒng)獲得不超過±1/2LSB的DNL;當(dāng)正負輸入端分別輸入頻率40.902MHz,相位相反的正弦信號時,SFDR為75.4584dB。證明所設(shè)計的子ADC不僅能確保ADC系統(tǒng)正常工作并達到指標要求,而且實現(xiàn)低功耗。 最后,采用

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