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1、隨著VLSI深亞微米工藝的不斷進(jìn)步，集成電路中的芯片的互連延時(shí)，以及互連線之間的信號(hào)完整性問(wèn)題已經(jīng)成為決定電路性能的關(guān)鍵因素。相比于優(yōu)化傳統(tǒng)的自動(dòng)化布線指標(biāo)（比如布通率，擁擠）所采用的策略，考慮更精確時(shí)延估計(jì)，串?dāng)_優(yōu)化等信號(hào)完整性指標(biāo)的布線策略往往要用到電路的高階矩。而傳統(tǒng)布線框架所采用的Elmore時(shí)延模型其本質(zhì)是電路的一階矩，實(shí)驗(yàn)已證明它對(duì)快速變化的信號(hào)具有較低的精確度，且從電路的一階矩也無(wú)法反映出電路上傳輸信號(hào)的波形質(zhì)量。所以最近
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