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文檔簡介
1、高精度計算、圖形加速、數(shù)字信號處理等應(yīng)用對浮點處理的要求越來越高，浮點運算單元(FPU)成為當(dāng)代微處理器中一個重要組成部分。由于集成電路技術(shù)的發(fā)展，芯片的集成密度大大提高。FPU的設(shè)計是一個熱點，但對于FPU的驗證總體來說缺乏相應(yīng)的關(guān)注。 本文來源于西北工業(yè)大學(xué)航空微電子中心所承擔(dān)的“十五”國防預(yù)研項目，作者參與完成了32位嵌入式RISC微處理器“龍騰R2”的設(shè)計，該款微處理器在接口和指令集上同PowerPC750處理器完全兼容
2、。本文主要討論其中的加減法運算的模擬驗證。 論文的主要工作如下：測試系統(tǒng)的搭建；按照經(jīng)典的黃金模型法搭建了一個驗證平臺；模型的劃分；將模型分為零次模型，一次模型，和二次模型，并分別產(chǎn)生測試向量；掩碼約束問題的解決；解決掩碼約束是本文的重點。設(shè)計了兩種定點數(shù)生成器，根據(jù)加法和減法的本身特性按照對齊位置將加減法分別分為若干類，從而有效地利用了各自的特點，降低了運算成本；范圍約束問題的解決；解決了以范圍條件為約束的測試向量產(chǎn)生問題。浮
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