基于憶阻器的存儲加密體系結(jié)構(gòu)技術(shù).pdf

1、存儲器是保存數(shù)據(jù)的載體，是保護數(shù)據(jù)的最后一道屏障。安全存儲對于信息安全意義重大。傳統(tǒng)安全存儲技術(shù)所面臨的問題的根源在于存儲器與處理器的分離。作為一種新型的納米電子器件，憶阻器的發(fā)現(xiàn)和研究為融合存儲與運算兩種功能提供了可能。在存儲方面，憶阻器由于其存儲密度高、耐久性好、功耗低、讀寫速度快、非易失性好等良好的器件特性引起了廣泛關(guān)注，已經(jīng)成為了新型非易失性存儲器研究的熱點。在運算方面，基于憶阻器的“狀態(tài)邏輯”運算功能的提出，為實現(xiàn)邏輯運算找到

2、了一條不同于傳統(tǒng)邏輯門電路的途徑。本文以密碼學(xué)領(lǐng)域的經(jīng)典加密算法為切入點，分析經(jīng)典加密算法的公共操作，設(shè)計存儲與運算融合的存儲加密體系結(jié)構(gòu)，研究通過憶阻器的狀態(tài)邏輯運算功能實現(xiàn)加密運算的設(shè)計方法，分析和設(shè)計存儲與加密運算相融合的電路結(jié)構(gòu)，并通過全面的實驗對系統(tǒng)的開銷和性能進行評估。本研究主要內(nèi)容包括：
　?、呕趹涀杵鞔鎯εc運算功能兼?zhèn)涞钠骷卣鳎疚脑O(shè)計了基于憶阻器的存儲加密體系結(jié)構(gòu)。在不需要將納米交叉桿陣列中的數(shù)據(jù)讀出的情況下

3、，通過在存儲陣列外圍增加加密運算控制模塊，直接對陣列內(nèi)的憶阻器存儲單元上存儲的數(shù)據(jù)進行運算操作。與傳統(tǒng)體系結(jié)構(gòu)相比，這樣的加密方式減少了數(shù)據(jù)在“搬移”過程中暴露的機會，提高了存儲系統(tǒng)的安全性。同時，由于納米交叉桿結(jié)構(gòu)天然的并行性，加密運算可以在陣列內(nèi)的多條字線上以及多個陣列上并行展開。這將極大地提高加密運算的吞吐率。為了評估系統(tǒng)的開銷與性能，本文以DES算法為例，設(shè)計和實現(xiàn)了加密運算控制模塊，并分別面向FPGA和基于標(biāo)準(zhǔn)單元的ASIC進

4、行了綜合。評估的結(jié)果表明，本系統(tǒng)在較小的面積開銷和功耗開銷下，可以達到極高的加密運算吞吐率。
　?、漆槍Π次划惢?、查找表、移位操作、加法和乘法操作、有限域GF(28)上的乘法逆、模冪和模乘等基本加密操作的具體運算過程，本文提出了具體的狀態(tài)邏輯運算序列的設(shè)計和優(yōu)化方法。結(jié)合憶阻器狀態(tài)邏輯操作的特點和經(jīng)典數(shù)字電路已有的設(shè)計方法，本文對比了每一種加密操作的多種設(shè)計方法，給出每一種操作的復(fù)雜度分析。通過與傳統(tǒng)數(shù)字邏輯電路設(shè)計的對比，本文發(fā)

5、現(xiàn)了狀態(tài)邏輯設(shè)計的運算特點，如在實現(xiàn)復(fù)雜邏輯功能時查找表方式具有較高的計算效率，以及循環(huán)次數(shù)為變量的循環(huán)操作實現(xiàn)效率較低等。本文還設(shè)計出了一些在本存儲加密體系結(jié)構(gòu)下特有的邏輯功能，如尋址移位、相對移位和條件賦值等?；炯用懿僮鞯难芯繛闃?gòu)建復(fù)雜加密算法奠定了理論基礎(chǔ)，也為硬件電路的設(shè)計提出了具體要求。
　?、窃诩{米交叉桿結(jié)構(gòu)上以狀態(tài)邏輯方式實現(xiàn)復(fù)雜加密算法的一個重要前提是陣列的規(guī)模與運算具有良好的可擴展性。本文從空間和時間兩個維度對

6、狀態(tài)邏輯運算電路的可擴展性進行分析。在空間上，得出了影響陣列可擴展性的關(guān)鍵參數(shù)是器件開關(guān)閾值電壓這一重要結(jié)論，并提出通過采用1S1R結(jié)構(gòu)的納米交叉桿陣列提高空間可擴展性的方法。在時間上，展示了已有電路設(shè)計在經(jīng)過多次運算后由于誤差累積導(dǎo)致錯誤發(fā)生的情況，設(shè)計了自適應(yīng)清零電路，將執(zhí)行蘊含操作時產(chǎn)生的誤差在清零操作時消除，提高了運算的可擴展性，避免了額外的刷新操作。通過對電路可擴展性的分析與設(shè)計，本文夯實了憶阻器狀態(tài)邏輯運算功能的電路基礎(chǔ)。<

7、br>　?、仍谧x電路方面，提出了納米交叉桿存儲陣列內(nèi)的多路復(fù)用讀出電路，相比已有的讀電路可以有效地降低外圍CMOS電路的開銷，從而更好地發(fā)揮憶阻器存儲陣列的高密度優(yōu)勢。通過對多個器件和電路參數(shù)的討論，得出憶阻器器件的非線性I-V特性或較高的低阻值特性可以改善多路復(fù)用讀出電路的可擴展性的結(jié)論。在寫操作方面，提出了面向納米交叉桿結(jié)構(gòu)的憶阻器編程電路。在不增加額外器件開銷的情況下，利用憶阻器自身的閾值特性實現(xiàn)準(zhǔn)確的多值編程，有效提高了存儲器的