一種用于高速D-A轉換器的高速流水線低邏輯復雜度DEM譯碼電路.pdf

1、數(shù)模轉換器(DAC)是現(xiàn)代數(shù)字和模擬電路中用途廣泛的重要接口部件。隨著計算機、數(shù)字信號處理、通信等技術的發(fā)展，DAC成為了提高信號處理速度和精度的關鍵。這些對DAC的精度和速度提出了更高的要求。在高速高精度DAC設計中，高速譯碼器是整個DAC設計的難點和瓶頸之一。
　　論文設計了一種用于高速高精度DAC的高速流水線低邏輯復雜度DEM譯碼電路，能有效地減少高速DAC中信號變換的非線性誤差。論文以14位DAC為例來說明這種譯碼方式的結

2、構特點。14位輸入采用5+5+4的分段混合譯碼方式，其中高五位和中五位都采用新型的低邏輯復雜度的DEM譯碼方式，低四位采用二進制譯碼方式。
　　論文采用Matlab對14位DEMDAC進行建模和仿真，當輸入信號頻率為121MHz，采樣頻率為1GHz時，無雜波動態(tài)范圍為99.84dB，信噪比為85.94dB，有效位數(shù)為13.9位，積分非線性誤差為0.522LSB，微分非線性誤差為0.259LSB?；赟MIC0.18μm1P6MCM