窄帶LDPC解碼-誤碼測(cè)試實(shí)驗(yàn)平臺(tái)設(shè)計(jì).pdf_第1頁(yè)
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文檔簡(jiǎn)介

1、本論文首先介紹并討論了數(shù)字電視傳輸標(biāo)準(zhǔn)TDS-OFDM的實(shí)現(xiàn)原理，對(duì)其中的一些關(guān)鍵問題做了詳細(xì)的分析，在此基礎(chǔ)上提出了一種基于FPGA的窄帶LDPC解碼-誤碼測(cè)試平臺(tái)設(shè)計(jì)方案，即利用時(shí)域PN頭同步及頻域?qū)ьl進(jìn)行功率估計(jì)的FPGA設(shè)計(jì)。 根據(jù)窄帶LDPC解碼-誤碼測(cè)試平臺(tái)實(shí)現(xiàn)的功能，本文提出了它的系統(tǒng)設(shè)計(jì)框圖，將其劃分為若干模塊。在對(duì)每一個(gè)模塊的設(shè)計(jì)要點(diǎn)做了詳細(xì)說明之后，采用Verilog語(yǔ)言編寫各模塊邏輯代碼，在Altera公司

2、的QuartusⅡ5.0集成開發(fā)環(huán)境下，基于Altera公司Stratix系列FPGA對(duì)各模塊及整個(gè)窄帶LDPC解碼-誤碼測(cè)試平臺(tái)進(jìn)行了仿真并將發(fā)端和收端的verilog程序分別下載到Altera的EP1S25F780C和EP1S80B956C6開發(fā)實(shí)驗(yàn)板進(jìn)行調(diào)試。仿真結(jié)果表明該設(shè)計(jì)能夠?qū)φ`碼率進(jìn)行統(tǒng)計(jì)。 本文中的設(shè)計(jì)是一個(gè)簡(jiǎn)化版本的OFDM數(shù)字電視傳輸系統(tǒng)。由于數(shù)字電視傳輸系統(tǒng)是一個(gè)復(fù)雜龐大的工程，為了驗(yàn)證數(shù)字電視傳輸系統(tǒng)中L

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