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1、目前廣州地鐵一號(hào)線仍采用全進(jìn)口車輛,其車輛總線由西門(mén)子公司研制,已運(yùn)行10年之久。為了解決一號(hào)線車輛總線設(shè)備老化、備件昂貴、采購(gòu)周期長(zhǎng)等問(wèn)題,同時(shí)也希望通過(guò)國(guó)產(chǎn)化技術(shù)改造,對(duì)原車輛總線進(jìn)行必要的優(yōu)化升級(jí),本文研究并優(yōu)化了廣州地鐵一號(hào)線車輛總線控制器。 針對(duì)廣州地鐵一號(hào)線車輛總線的協(xié)議規(guī)范,本文以現(xiàn)場(chǎng)可編程門(mén)陣列(FPGA)為平臺(tái)設(shè)計(jì)了具有自主知識(shí)產(chǎn)權(quán)的數(shù)據(jù)鏈路層和物理層軟核。數(shù)據(jù)鏈路層軟核主要由先入先出(FIFO)模塊,循環(huán)冗余
2、碼校驗(yàn)(CRC)模塊,串并轉(zhuǎn)換模塊等組成。其中FIFO模塊用于解決異步時(shí)鐘讀寫(xiě)緩存問(wèn)題;CRC模塊用于收發(fā)雙方校驗(yàn)數(shù)據(jù);串并轉(zhuǎn)換模塊用于實(shí)現(xiàn)8路并行數(shù)據(jù)和串行數(shù)據(jù)的轉(zhuǎn)換。物理層軟核主要用于完成不歸零碼(NRZ)與曼徹斯特碼之間的轉(zhuǎn)換,以及從輸入的曼徹斯特碼中提取位同步時(shí)鐘。位同步時(shí)鐘不但是編解碼模塊的基準(zhǔn)時(shí)鐘,其二分頻后也是數(shù)據(jù)鏈路層模塊的基準(zhǔn)時(shí)鐘。本文采用了構(gòu)造FPGA片內(nèi)全數(shù)字鎖相環(huán)(DPLL)的方法來(lái)實(shí)現(xiàn)位同步時(shí)鐘的提取,此方案具
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